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台積電延High-NA EUV至2029
💡台積電跳4.1億光刻機—重塑AI晶片製造時程 (22字)
⚡ 30-Second TL;DR
有什麼變化
High-NA EUV單台4.1億美元，現EUV兩倍
為什麼重要
延緩全球先進AI晶片節點競賽；提升台積電利潤但恐落後對手。
下一步行動
優化現有EUV模擬多重圖案化流程，用於AI晶片設計。
誰應關注：Developers & AI Engineers
關鍵要點
- •High-NA EUV單台4.1億美元，現EUV兩倍
- •台積電用現有EUV多重曝光縮小節點
- •英特爾/三星積極採用；台積電優先利潤
🧠 深度解析
AI-generated analysis for this event.
🔑 增強重點摘要
- •台積電透過優化現有的 0.33 NA EUV 曝光機，結合先進的圖案化技術（Patterning），已成功在 2nm 節點實現與 High-NA EUV 相當的解析度，證明了現有設備的延壽潛力。
- •ASML 的 High-NA EUV 設備（EXE:5000/5200 系列）在導入初期面臨光阻劑（Photoresist）材料相容性與晶圓平坦度挑戰，台積電選擇觀望以規避初期技術成熟度風險。
- •台積電的策略轉向「成本效益優先」，旨在避免過早投入高昂的資本支出（CapEx），以維持在 AI 晶片代工市場的毛利率優勢，並將資源集中於先進封裝（CoWoS）產能擴充。
📊 競品分析▸ Show
| 特性/廠商 | 台積電 (TSMC) | 英特爾 (Intel) | 三星電子 (Samsung) |
|---|---|---|---|
| High-NA EUV 導入策略 | 延後至 2029 (A13) | 已導入 (18A/14A) | 積極導入 (SF2P/SF1.4) |
| 核心技術路徑 | 現有 EUV 多重曝光 + 先進封裝 | 激進採用 High-NA EUV | 激進採用 High-NA EUV |
| 資本支出考量 | 極度保守，追求利潤最大化 | 積極擴張，追求技術領先 | 積極擴張，追求市佔率 |
🛠️ 技術深入
- High-NA EUV (0.55 NA) 相比現有 EUV (0.33 NA) 可將解析度提升約 1.7 倍，但因鏡頭數值孔徑變大，導致曝光視場（Field Size）縮減為原來的一半，需進行晶片切割優化。
- 台積電採用的多重曝光技術（Multi-patterning）雖能繞過 High-NA 需求，但會增加製程步驟與光罩成本，台積電透過提升 EUV 曝光機的生產效率（WPH, Wafers Per Hour）來抵銷成本增加。
- 針對 A13 節點，台積電預計將結合 High-NA EUV 與新型金屬閘極材料，以進一步降低電晶體漏電流並提升開關速度。
🔮 前景展望AI analysis grounded in cited sources
台積電將在 2026-2028 年間維持極高的資本支出效率。
透過延後採購昂貴的 High-NA EUV 設備，台積電能將更多資金配置於需求強勁的 CoWoS 先進封裝產能擴張。
ASML 的 High-NA EUV 營收成長將在短期內依賴英特爾與三星。
台積電作為全球最大晶圓代工廠，其延後採購決策將直接影響 ASML 在 High-NA 設備的出貨量預測與財務表現。
⏳ 時間線
2023-12
ASML 向英特爾交付首台 High-NA EUV 曝光機 (EXE:5000)。
2024-07
台積電在技術論壇暗示現有 EUV 設備足以支撐 2nm 及後續節點。
2025-05
台積電宣布 A16 製程將持續優化現有 EUV 曝光技術。
2026-02
台積電內部評估報告確認將 High-NA EUV 導入時程推遲至 2029 年。
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